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【中文文档】RM0430_STM32F413/423单片机参考手册

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STMCU-管管 发布时间:2019-3-21 10:47
STM32F413/423单片机参考手册* O4 D( Z3 `6 C" Z' }8 K8 F& a) l

+ n' x4 _4 D! q( [& @前言
5 r* B' U9 ^1 F& b4 ]
) F: n3 C8 s( B. d4 a
本参考手册面向应用开发人员, 提供有关使用 STM32F413/423 微控制器存储器与外设的完整信息。
& E, m( f# ?! Y4 K. `
' E$ K% P8 C: F  Z% ^+ S5 y7 Y. ~( r
STM32F413/423 构成一个微控制器系列,各产品具有不同的存储器大小、封装和外设。有关订购信息以及器件的机械与电气特性,请参见数据手册。
+ f* A* }: j6 A1 c# [6 h- F/ u% t$ [
有关 Arm® 带 FPU 的 Cortex®-M4 内核的信息,请参见Cortex®-M4 技术参考手册。
- b1 X* g2 z* e: @
! m4 v- J, c/ N  W6 b5 G# _' q相关文档意法半导体网站 www.st.com 提供以下文档: 9 Y; I5 S, I9 Z8 k: p% f

+ W+ @9 s3 D' K
  • STM32F413/423xG/xH 数据手册
  • STM32F3 和 STM32F4 系列带 FPU 的 Cortex®-M4 编程手册 (PM0214),提供关于 Arm带 FPU 的 Cortex®-M4 的信息。4 s, C- i+ R2 |% ?# D: \8 G; P

, \' q( |" Z$ M! o* Q5 ?4 E* f# \' C1 文档约定
$ w! k2 }$ j9 H% U# A
4 M+ G% y4 [/ B$ l! U# Q2 x1.1 一般信息
9 R# P# D1 u  d+ k" M2 P
  d, e8 u+ S, d  k/ m3 L. C+ A" X4 P4 P7 xSTM32F413/423 器件具有 Arm®(a) Cortex®-M4 with FPU 内核
, G. i, H1 n# c1 u( G3 I9 c3 h' a* L3 [, u/ z/ |2 u$ a. v
1.2 寄存器相关缩写词列表 1 @% Y" h  d7 L$ v2 X! X1 m1 `& p
$ Z9 Y  a1 J/ c! F
寄存器说明中使用以下缩写词(b):  $ t% s  Q) c; \+ ?
. N3 H% |: V1 o6 t2 N
读/写 (rw)                           软件可以读写该位。 $ o+ k1 D; ~7 b
只读 (r)                               软件只能读取该位。
1 i& Q  {% b, Z2 q只写 (w)                              软件只能写入该位。读取该位时将返回复位值。
; x/ |8 N0 s! D  p  z; V9 B读取/写入 0 清零 (rc_w0)      软件可以通过读取该位,也可以通过写入 0 将该位清零。写入 1 对该位的值无影响。
4 t5 h4 |0 [* j! ^读取/写入 1 清零 (rc_w1)      软件可以通过读取该位,也可以通过写入 1 将该位清零。写入 0 对该位的值无影响。 2 N7 Q& k  a3 g5 X! M
读取/写入清零 (rc_w)           软件可以通过读取该位,也可以通过写入寄存器将该位清零。写入该位的值并不重要。 + B0 p. ^+ |. R) I; f
读取/读取清零 (rc_r)            软件可以读取该位。读取该位时,将自动清零。写入该位对其值无影响。
0 l% `. E0 H9 p! E8 Y# {4 C读取/读取置位 (rs_r)            软件可以读取该位。读取该位时,将自动置位。写入该位对其值无影响。 & C- `4 X, W9 R* F- B( Q
读取/置位 (rs)                     软件可以读取该位,也可将其置 1。写入 0 对该位的值无影响。
7 o8 n" p! X% s' o) o# F' ^& Y7 N读/仅可写入一次 (rwo)        软件仅可写入一次该位,但可随时读取该位。只能通过复位将该位返回到复位值。 & m/ k- x: m5 D+ z  d# V: _1 y
切换 (t)                              软件可以通过写入 1 来切换该位。写入 0 无影响。
+ ~8 A* C+ [' @! S! X, I只读写触发 (rt_w1)             软件可以读取该位。写入 1 时,将触发事件,但不会影响该位的值。 0 D2 i- U2 W" B. t) S- V7 ~
保留 (Res.)                        保留位,必须保持复位值。; _+ j$ ?( i% o/ {- ?( V
, H" K. S" B  z7 k' {/ a- b
1.3 词汇表
3 L" j4 p0 I3 G

, s6 r1 E# z  A# E本节简要介绍本文档中所用首字母缩略词和缩写词的定义:
  l6 r! K0 a( I9 U  e; _* g$ O' ^
  • 字:32 位数据。
  • 半字:16 位数据。
  • 字节:8 位数据。
  • IAP(在应用中编程):IAP 是指可以在用户程序运行期间对微控制器的 Flash 进行重新编程。
  • ICP(在线编程):ICP 是指可以在器件安装于用户应用电路板上时使用 JTAG 协议、SWD 协议或自举程序对微控制器的 Flash 进行编程。
  • 选项字节:存储于 Flash 中的产品配置位。
  • AHB:高级高性能总线。
    7 I; C+ M- o$ V+ N
% j2 F& ?6 d7 c8 w6 {
1.4 外设可用性
8 g/ x  a# [+ @+ L6 x/ `/ d有关各型号产品的外设可用性及数量的信息,请参见特殊器件数据手册。
" p. D  X3 I9 I! u: l2 d
2 系统和存储器概述
& z) D% c( l& Q# M7 i1 J$ p# a
1 K& I* b& j$ \) b
2.1 系统架构 2 E3 {7 W+ Y: e, r: |; M8 \4 W
" n7 r4 s% V, |$ g7 ~& c' J
STM32F413/423 的主系统由 32 位多层 AHB 总线矩阵构成,可实现以下部分的互连: 4 w( e' m; N* T6 T

% _9 p4 ?4 n; j6 a六条主控总线:
3 F5 \/ _- S7 ^5 M9 b   – 带 FPU 的 Cortex®-M4内核 I 总线、D 总线和 S 总线
' I2 k! }. C5 O   – DMA1 存储器总线 . D2 v- r, `9 B% p' _6 X! g
   – DMA2 存储器总线 ) x4 _. y4 B7 N$ ~
   – DMA2 外设总线
; w6 ]- L, }# b  C* F( [% P' H
$ S7 Y+ y7 J1 ~, q0 f: g
七条被控总线:
+ @% g) Q: y' K; _; J/ a1 o   – 内部 Flash ICode 总线 % M! M1 ?( d9 X/ N4 Y1 B3 _
   – 内部 Flash DCode 总线 " b$ k8 @# n+ Y3 v1 m+ s
   – 主内部 SRAM1 (256 KB)
$ g9 Q# e& W4 m6 f0 c, x7 g   – 辅助内部 SRAM2 (64 KB) 7 W9 @' o' }/ G7 a- I
   – AHB1 外设(包括 AHB-APB 总线桥和 APB 外设) 1 n9 V, p5 }$ C$ W
   – AHB2 外设
- f5 R5 L! k+ C0 N" G& l. e- z   – FSMC/QuadSPI
. m# |! u  l1 z/ [& {- r
& X' T  w; W  |# ?. H. J借助总线矩阵,可以实现主控总线到被控总线的访问,这样即使在多个高速外设同时运行期间,系统也可以实现并发访问和高效运行。此架构如图 1 所示。+ W% _: g. }" H, t' c4 I
+ M3 Q8 \2 {8 `' ]$ V
1.png
4 |* N" V0 ?* M4 _& S
2.1.1 I 总线
- v5 y4 O" ^4 w* m; O
此总线用于将带 FPU 的 Cortex®-M4 内核的指令总线连接到总线矩阵。内核通过此总线获取指令。此总线访问的对象是包含代码的存储器(内部 Flash/SRAM1/SRAM2)。
0 J. x- _. y; ~# V5 _: ]4 X" G
2.1.2 D 总线
8 B5 w2 R& Z& X4 m1 M
此总线用于将带 FPU 的 Cortex®-M4 的数据总线连接到总线矩阵。内核通过此总线进行立即数加载和调试访问。此总线访问的对象是包含代码或数据的存储器(内部 Flash/SRAM1/SRAM2)。

1 ]9 g" c, F1 B  w# t# J* u4 _+ X
2.1.3 S 总线

# B( I3 E' s  p' S5 r
此总线用于将带 FPU 的 Cortex®-M4 内核的系统总线连接到总线矩阵。此总线用于访问位于外设、SRAM1 或 SRAM2 中的数据。也可通过此总线获取指令(效率低于 ICode)。此总线访问的对象是内部 SRAM1/SRAM2、包括 APB 外设在内的 AHB1 外设、AHB2 外设和外部存储器(通过外设接口 FSMC 和 QUADSPI)。
9 W/ O6 k3 W' l+ @
..............

6 B( d* h6 n$ Z7 h$ {
想了解更多,请下载原文阅读
1 y9 P$ h) i$ Y0 w# e4 @/ X

+ H: H- f: U# Y  x; S% u# _( I7 k5 F1 r! A8 q6 D5 \. J
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