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【中文文档】基于 ARM 内核的 32 位高级 MCU

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STMCU-管管 发布时间:2019-3-13 16:55
基于 ARM 内核的 32 位高级 MCU5 ?. [7 X8 g& P

1 R$ [: x$ n& N$ |$ w# U5 D+ z前言

* ?* H' n! w1 @6 V1 J  c5 M' [

0 w& @, Q) ^$ b1 u本参考手册面向应用开发人员, 提供有关使用 STM32H7x3 微控制器存储器与外设的完整信息。 ! h- [' L6 u; ~* d: o) B

! @' D3 Z1 C0 W! e  l& t* eSTM32H7x3 构成一个微控制器系列,各产品具有不同的存储器大小、封装和外设。
) Q, j% m* f0 X+ s8 j
% R- v8 `1 a4 ^' S5 p
有关订购信息以及器件的机械与电气特性,请参见相应的数据手册。 8 u  |7 M0 H: Q" z( v
# u, ^1 }/ N) v, v6 Z- z
有关带 FPU 的 ARM® Cortex®-M7 内核的信息,请参见相应的 ARM 技术参考手册。
& V# N# G/ h" H8 C6 G

6 k; C( s4 v, X) L: {- F0 D$ ]相关文档$ g2 E8 B+ B+ M9 m
  • ARM® Cortex®-M7 技术参考手册,可从 www.arm.com 获取。
    9 X* l$ d0 B7 a/ j8 j6 C
  • Cortex®-M7 编程手册 (PM0253)。
    " c( T1 E* r, d3 w$ ^7 V! s' F$ G
1 文档约定 3 w, M1 }8 g& u
% u: q4 g6 g( M
1.1 寄存器相关缩写词列表寄存器说明中使用以下缩写词:
" P2 L7 `/ s; X" y, Q3 J5 w
  • 读/写 (rw)    软件可以读写该位。只读 (r) 软件只能读取该位。
  • 只写 (w)      软件只能写入该位。读取该位时将返回复位值。
  • 读取/清零 (rc_w0)   软件可以读取该位,也可以通过写入 0 将该位清零。写入 1 对该位的值无影响。
  • 读取/清零 (rc_w1)       软件可以读取该位,也可以通过写入 1 将该位清零。写入 0 对该位的值无影响。
  • 读取/读取清零(rc_r)   软件可以读取该位。读取该位时,将自动清零。写入该位对其值无影响。
  • 读取/置位 (rs)            软件可以读取该位,也可将其置 1。写入 0 对该位的值无影响。
  • 保留 (Res.)                保留位,必须保持复位值。3 H; `, C* s4 Y4 P* o2 {
1.2 词汇表 ; ^$ J" [( o9 P5 ?0 x
本节简要介绍本文档中所用首字母缩略词和缩写词的定义:

% [  F0 g6 y4 K8 ]( S
  • 字:32 位数据。
  • 半字:16 位数据。
  • 字节:8 位数据。
  • 双字:64 位数据。
  • Flash 字:256 位数据。
  • IAP(在应用中编程):IAP 是指可以在用户程序运行期间对微控制器的 Flash 进行重新编程。
  • ICP(在线编程):ICP 是指可以在器件安装于用户应用电路板上时使用 JTAG 协议、SWD 协议或自举程序对微控制器的 Flash 进行编程。
  • 选项字节:存储于 Flash 中的产品配置位。
  • AHB:高级高性能总线。
  • AXI:高级可扩展接口协议。
  • PCROP:专有代码读保护。
  • RDP:读保护。
    ! @) p5 ^+ _! q$ h/ |5 H
8 |3 v1 q' v9 Z& \0 G4 I# D/ A
1.3 外设可用性
. T3 `8 Q9 K' n! s5 g& y( C) Y5 s. P+ g
有关各型号产品的外设可用性及数量信息,请参见特殊器件数据手册。
2 M) B9 o* a6 U' B/ G% |( p4 e

! u9 j) M; W. h$ \2 存储器和总线架构
! v  l( Z: v2 s4 U1 o  q+ J2 f" E7 A7 I+ M
2.1 系统架构 & t6 h1 m# d$ P5 X) V+ Q3 W7 l

' I3 E5 l8 y/ I通过一个 AXI 总线矩阵、两个 AHB 总线矩阵和总线桥,可以将总线主设备与总线从设备实现互连,如表 1 和图 1 所示。
$ Z- w" ?* p2 v( z; _2 b9 a& u: A) l( u( z9 A2 j2 ?
1.png
2.png
1.png ' X$ _7 Z  F/ S: i4 u+ _5 t
2.1.1 总线矩阵

# _" _( R& L, b7 f# n( a6 `) E
D1 域中的 AXI 总线矩阵
7 \6 |. i! Z* S4 B
D1 域中的多 AXI 总线矩阵为从多个主设备到多个从设备的并发访问提供保证和仲裁。这样可实现高速外设的高效同步运行。

2 C4 `/ E7 c& S& O- J* ~) m
仲裁采用带 QoS 功能的轮循调度算法。
2 k2 Y$ _/ c2 k$ U; `" ^9 S
DTCM 和 ITCM(数据和指令紧密耦合 RAM)通过专用 TCM 总线直接连接到 Cortex-M7 内核。MDMA 控制器可通过 AHBS(特定的 CPU 从设备 AHB)访问 DTCM 和 ITCM。ITCM由 Cortex-M7 以 CPU 时钟速度(零等待周期)访问。
0 H+ F) {2 ]9 b2 s! y) V9 k
有关 AXI 互连的更多信息,请参见 第 5 节:AXI 互连。
7 d2 v- u$ G1 |2 q' w
D2 域和 D3 域中的 AHB 总线矩阵
9 ?+ c7 z+ K" w2 G* ~9 A
D2 域和 D3 域中的 AHB 总线矩阵为从多个主设备到多个从设备的并发访问提供保证和仲裁。这样可实现高速外设的高效同步运行。

  a; B$ [6 Z! R" x9 b$ E. W
仲裁采用循环调度算法。
2.1.2 总线-总线桥

6 D6 _1 o) a( z9 C' A1 Y( a
系统中具有大量的总线-总线桥,用于在不同总线类型的外设之间实现通信。
" F' w9 L, p) `. I
D1 和 D3 域中的 AHB/APB 总线桥可将 APB3 和 APB4 上的外设分别连接到 AHB3 和AHB4。D2 域中的 AHB/APB 总线桥可将 APB1 和 APB2 上的外设连接到 AHB1。这些AHB/APB 总线桥提供完全同步接口,允许 APB 外设依靠与其所连接的 AHB 无关的时钟来运行。
" b' a" ~% L  D3 f
AHB/APB 总线桥还可将 APB1 和 APB2 外设分别连接到 DMA1 和 DMA2 外设总线,而无需通过 AHB1。
5 e8 ~& s8 i  F# ?
AHB/APB 总线桥可将 8 位/16 位 APB 数据转换为 32 位 AHB 数据,具体通过将 8 位/16 位APB 数据复制到 32 位字的三个高位字节/高位半字来实现。

# N# [3 Q  c/ @9 s) O6 o+ @1 f. v8 w
AXI 总线矩阵在其从总线接口上集成 AHB/AXI 总线桥功能。图 1 中标记为 32 位的主设备接口上的 AXI/AHB 总线桥在矩阵外部。

7 x! N8 V3 O2 F& G/ s! z
Cortex-M7 CPU 从其 AHBS 从设备 AHB 提供 AHB/TCM 总线(ITCM 和 DTCM 总线)转换,以允许 MDMA 控制器访问 ITCM 和 DTCM。
5 G, A  L7 _, c7 C/ ]0 X
2.1.3 域间总线

1 s/ H3 y5 x+ C; t9 r0 q* s8 R: I
D2-D1 AHB

! i. x7 i  C/ c4 K" D) H; D# i
该 32 位总线将 D2 域连接到 D1 域中的 AXI 总线矩阵。它使得 D2 域中的总线主设备能够访问 D1 域中的资源(总线从设备),以及通过 D1-D3 AHB 间接访问 D3 域中的资源(总线从设备)。
D1-D2 AHB
5 N) Z/ z/ C+ M& k% a3 L9 V
该 32 位总线将 D1 域连接到 D2 域 AHB 总线矩阵。它使得 D1 域中的总线主设备能够访问D2 域中的资源(总线从设备)。
& N& K; C- O: p( M6 u- g  @
..............

, Y! l- U' h' z( Y! ]6 E  C# Z$ u
想了解更多,请下载原文阅读

4 ^$ {7 ^' X" {  c7 t- D

4 C. F# m& E" Y- O& b
6 ~% e! |( M1 j$ A& G
6 S7 _) d8 q5 g
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